IC設(shè)計工具很多，其中按市場所占份額排行為Cadence、Mentor Graphics和Synopsys。
1)設(shè)計輸入工具：
像Cadence的composer，viewlogic的viewdraw，硬件描述語言VHDL、Verilog HDL是主要設(shè)計語言，許多設(shè)計輸入工具都支持HDL。另外像Active—HDL和其它的設(shè)計輸入方法，包括原理和狀態(tài)機(jī)輸入方法，設(shè)計 FPGA/CPLD的工具大都可作為IC設(shè)計的輸入手段，如Xilinx、Altera等公司提供的開發(fā)工具，Modelsim FPGA等。
2)設(shè)計仿真工作：
EDA工具的一個最大好處是可以驗證設(shè)計是否正確，幾乎每個公司的EDA 產(chǎn)品都有仿真工具。Verilog—XL、NC—verilog用于Verilog仿真，Leapfrog 用于VHDL仿真，Analog Artist用于模擬電路仿真。Viewlogic的仿真器有：viewsim門級電路仿真器，speedwaveVHDL仿真器，VCS— verilog仿真器。Mentor Graphics有其子公司Model Tech 出品的VHDL和Verilog雙仿真器：Model Sim。Cadence、Synopsys用的是VSS(VHDL仿真器)。現(xiàn)在的趨勢是各大EDA公司都逐漸用HDL仿真器作為電路驗證的工具。
3)綜合工具：
綜合工具可以把HDL變成門級網(wǎng)表。這方面Synopsys工具占有較大的優(yōu)勢，它的Design Compile是綜合的工業(yè)標(biāo)準(zhǔn)，它還有另外一個產(chǎn)品叫Behavior Compiler，可以提供更高級的綜合。此外，美國還出了一家軟件叫Ambit，比Synopsys的軟件更有效，可以綜合50萬門的電路，速度 更快。不過Ambit已被Cadence公司收購，為此Cadence放棄了它原來的綜合軟件Synergy。
隨著FPGA設(shè)計的規(guī)模越來越大，各EDA 公司又陸續(xù)開發(fā)了用于FPGA設(shè)計的綜合軟件，比較有名的有：Synopsys的FPGA Express，Cadence的Synplity，Mentor的Leonardo，這三家的FPGA綜合軟件占了市場的絕大部分。
4)布局和布線：
在 IC設(shè)計的布局布線工具中，Cadence軟件是比較強(qiáng)的，它有很多產(chǎn)品，用于標(biāo)準(zhǔn)單元、門陣列已可實現(xiàn)交互布線。最有名的是Cadence spectra，它原來是用于PCB布線的，后來Cadence把它用來作IC的布線。
其主要工具有：Cell3，Silicon Ensemble—標(biāo)準(zhǔn)單元布線器;Gate Ensemble—門陣列布線器;Design Planner—布局工具。其它各EDA軟件開發(fā)公司也提供各自的布局布線工具。
5)物理驗證工具：
物理驗證工具包括版圖設(shè)計工具、版圖驗證工具、版圖提取工具等等。這方面Cadence也是很強(qiáng)的，其Dracula、Virtuso、Vampire等物理工具有很多的使用者。
6)模擬電路仿真器：
前面講的仿真器主要是針對數(shù)字電路的，對于模擬電路的仿真工具，普遍使用SPICE，這是唯一的選擇。只不過是選擇不同公司的 SPICE，像MiceoSim的PSPICE、Meta Soft的HSPICE等等。HSPICE現(xiàn)在被Avanti公司收購了。在眾多的SPICE中，最好最準(zhǔn)的當(dāng)數(shù)HSPICE，作為IC設(shè)計，它的模型最 多，仿真的精度也最高。
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